Home Seminare und Kurse Design-Kurse Leiterplatten- und Baugruppendesign Kurs I

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19.-21. September 2013 in Bremen

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Zugelassener Bildungsträger nach AZWV

Leiterplatten- und Baugruppendesign Kurs I

27.-31.05.2013, Stoos (Schweiz)
10.-14.06.2013, Fulda
22.-26.07.2013, Neustadt/Aisch
21.-25.10.2013, Neustadt
18.-22.11.2013, Neustadt

Zur Online-Anmeldung

Einführung

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Ein wesentlicher inhaltlicher Schwerpunkt des Kurses ist die Vermittlung der technologischen Kompetenz für produktionsgerechtes Design. Ein weiterer die Vorbereitung des Designers auf seine zentrale Rolle innerhalb der Wertschöpfungskette und damit auf alle Phasen des Produktkreationsprozesses. Durch zahlreiche instruktive Beispiele wird die Notwendigkeit dieser Einbindung belegt und auf angemessene Verhaltensregeln hingewiesen.

Der Leiterplatten- und Baugruppen-Design-Kurs I bietet einen umfassenden Einblick in das Rüstzeug des Designers und befähigt die Teilnehmer, das Wissen aus den verschiedenen Bereichen von der Elektrophysik bis zu Löt- und Testverfahren interdisziplinär zu vernetzen.

 

 

Mit der Prüfung zum Certified Interconnect Designer (CID), einer der wenigen anerkannten Qualifikationsnachweise für Baugruppen-Designer, schließt der Kurs ab.

pdficon Aktueller Schulungsflyer als PDF-Datei:
Leiterplatten und Baugruppendesign Kurs I

Zielgruppe

Der Leiterplatten- und Baugruppendesign-Kurs I führt die Grundlagen, die zur Arbeit am heutigen Design unentbehrlich sind, zusammen.

Er richtet sich vor allem an bereits aktive Leiterplattendesigner. Es ist deshalb wünschenswert, wenn die Teilnehmer bereits über Grundkenntnisse des Aufbaus, der Fertigung, dem Einsatz und der Funktion von Leiterplatten bzw. Baugruppen verfügen.

Kursthemen

Block 1: Rolle der Designer im Produktkreationsprozess

  • Wichtige Design-Regelwerke: DIN/IEC, IPC
  • Auftragsübernahme, Zeit- und Kosteneinschätzung
  • Leiterplattenkonzeptgespräch
  • Qualitätsmerkmale, DIN-ISO9000
  • Verhalten in der Schnittstellenfunktion
  • Team-, Koordinierungs-, Konfliktfähigkeit

Block 2: Fertigungstechnologie Baugruppenfertigung

  • Produktklassifizierung
  • Einfluss des Baugruppentests auf das Design
  • Einflüsse der Fertigungsabläufe auf das Design
  • Beispiel: Einfluss Abnahmekriterien

Block 3: Fertigungstechnologie LP-Herstellung

  • Elementare Designrichtlinien aus der LP-Fertigung
  • Datenformate und Dokumentation in der LP-Fertigung
  • Materialeinfluss auf die Wirtschaftlichkeit
  • Galvanische Oberflächen und ihr Designeinfluss
  • Fehlerbeispiele aus der Fertigung

Block 4: Zusammenführung der Designgrundlagen

  • Designkriterien und Eingangsdatenbearbeitung
  • Vorgaben aus der mechanischen Konstruktion, thermische und EMV-Vorgaben
  • Designvorgaben der Schaltungsentwicklung, Teststrategien, Schaltplanübernahme
  • Hinweise zu Bauteilebibliotheken
  • Designstrategie und Machbarkeit

Block 5: Designregeln für die konkrete Layouterstellung

  • Bauteilplatzierung, Wärmemanagement, Anschlussflächen
  • EMV-gerechtes Platzieren, Schaltungsgruppenverteilung
  • Entflechtung, Leiterzuggeometrie, Stromversorgung
  • Entkoppelung, Übersprechen, Impedanzkontrolle
  • Designintegrität

Block 6: Form der Dokumente und Fertigungsunterlagen

  • Fertigungsunterlagen, Daten und Dokumentation
  • Freigaben, Verteilung und Archivierung
  • Änderungsvorgang und Dokumentation

Prüfung zum CID

CID-Prüfung

Die Prüfung zum Certified Interconnect Designer (CID) ist einer der wenigen anerkannten Qualifikationsnachweise für Leiterplatten- und Baugruppen-Designer.

Zertifizierten Designern wird das Recht zuerkannt, offiziell ihrem Namen die Beifügung „CID“ (Certified Interconnect Designer) hinzuzufügen und so auf ihren Qualifikationsnachweis aufmerksam zu machen. Durch den Erwerb des Zertifikats in unterschiedlichen Ländern auf Basis einheitlicher Prüfungsinhalte und -bedingungen findet ein internationaler Wissensabgleich statt.

Durch den FED ausgebildete CID

Der Leiterplatten- und Baugruppen Design Kurs I beinhaltet bereits die Prüfung zum CID, inkl. der vorbereitenden Prüfungsunterlagen (Study Guide) des IPC in Deutsch.

Zudem haben die Teilnehmer die Möglichkeit die CID-Prüfung zu einem späteren Zeitpunkt abzulegen bzw. bei Nichtbestehen, die Prüfung zu wiederholen. In dem Falle kann die Prüfung extra gebucht werden.

Nur Prüfung zum CID buchen

Schulungszeiten

Mo            Anreise bis 10:30 Uhr
Mo            10:30 - 17:00 Uhr
Di-Do         08:30 - 17:00 Uhr
Fr              08:30 - 12:00 Uhr
Fr              CID-Prüfung 13:00 Uhr
Fr              Abreise 16:00 Uhr

Schulungsorte und Teilnahmegebühren

Schweiz

27.-31.05.2013

Zur Online-Anmeldung

Seminar- und Wellnesshotel Stoos
Ringstraße 10
CH-6433 Stoos
Tel.: 0041/ 41 8174444

Teilnahmegebühren

FED-Mitglieder: 2.810,- EUR   (inkl. 880,- EUR Verpflegung und Übernachtung)

Nichtmitglieder: 3.340,- EUR   (inkl. 880,- EUR Verpflegung und Übernachtung)

Bitte geben Sie bei Ihrer Anmeldung an, ob die Anreise am Vortag gewünscht ist. Voranreise HP für 1 Person zum Preis von 155,- EUR (CHF 187.00).

Enthaltene Leistungen

IPC-Prüfung zum CID, ausführliche Schulungsunterlagen (Ordner und CD-ROM), Seminarraumbenutzung, 5 x Mittagessen, 4 x Übernachtungen im Einzelzimmer, 4 x Frühstück, 4 x Abendessen, freie Benutzung von Wellness und Spa, alkoholfreie Pausengetränke sowie Tickets für die Zubringerbahn/Luftseilbahn Morschach-Stoos (Stichwort FED). Sie erhalten bei den Zubringerbahnen ein Retourticket und können dieses an der Kasse abholen.

Fulda

10.-14.06.2013

Zur Online Anmeldung

ITZ - Wirtschaftsförderungsgesellschaft mbH
Informationstechnologie-, Gründer- und Multimediazentrum Fulda
Am Alten Schlachthof 4
36037 Fulda

Wir bitten Sie, Ihre Übernachtungen selbst zu buchen. Es wurde ein Abrufkontingent eingerichtet - Stichwort: "FED":

HOTEL AM DOM
Wiesenmühlenstraße 6
36037 Fulda
Tel.: 0661/979 80

1 Einzelzimmer zu EUR 69,-./Nacht inkl. Frühstücksbuffet und PKW-Stellplatz. Dieses Abrufkontingent steht Ihnen bis zum 10.05.2013 zur Verfügung. Tel.: 0661/979-80.

Teilnahmegebühren

FED-Mitglieder:  2.170,- EUR (inkl. 240,- EUR für Verpflegung ohne Übernachtung)

Nicht-Mitglieder:  2.700,- EUR (inkl. 240,- EUR für Verpflegung ohne Übernachtung)

Enthaltene Leistungen

IPC-Schulung zum CID, ausführliche Schulungsunterlagen (Ordner und CD-ROM), Seminarraumbenutzung, 5 x Mittagessen, Kaffeepausen und alkoholfreie Pausengetränke. Bitte buchen Sie Ihre Zimmer selbst.

Neustadt/Aisch

22.-26.07.2013
21.-25.10.2013
18.-22.11.2013

Zur Online Anmeldung

BVS Bildungszentrum
Neustadt
Comeniusstr. 3
91413 Neustadt / Aisch
Tel. 09161/7810

Übernachtung

Allee-Hotel Neustadt
Alleestraße 14
91413 Neustadt/Aisch

Teilnahmegebühren

FED-Mitglieder: 2.350,- EUR (inkl. 420,- EUR Verpflegung und Übernachtung)

Nichtmitglieder: 2.880,- EUR (inkl. 420,- EUR Verpflegung und Übernachtung)

Bitte geben Sie bei Ihrer Anmeldung an, ob die Anreise am Vortag gewünscht ist. Übernachtung /Frühstück pro Person  zum Preis von 64,50 EUR.

Enthaltene Leistungen

Ausführliche Schulungsunterlagen (Ordner und CD-ROM), IPC-Prüfung zum CID, EDV- und Lehrsaalbenutzung, 4 x Übernachtung im Einzelzimmer, 4 x Frühstück, 5 x Mittagessen, 4 x Abendessen sowie alkoholfreie Pausengetränke.

Bedingungen

Die Teilnehmerzahl ist auf 12 Personen pro Kurs begrenzt.

Nach Eingang Ihrer Anmeldung erhalten Sie eine Rechnung als Teilnahmebestätigung. Der Kostenbeitrag ist vor Veranstaltungsbeginn an den FED zu überweisen. Bitte zahlen Sie erst nach Erhalt der Rechnung. Bei Stornierung der Anmeldung (nur schriftlich bis eine Woche vor Kursbeginn - Poststempel) wird eine Verwaltungsgebühr in Höhe von 10 % des Gesamtrechnungsbetrages (Kurs- und Prüfungsgebühr und Vollpension) erhoben. Danach ist in jedem Fall der volle Betrag zu zahlen. Bei Nichterscheinen oder verspäteter Abmeldung besteht kein Anspruch auf Rückerstattung der Teilnahmegebühr. Der Veranstalter behält sich das Recht vor, den Kurstermin auch nach erfolgter Anmeldebestätigung bei Rückerstattung der Gebühren abzusagen.

Die Schulungen werden in Deutsch gehalten.

Es gelten im Übrigen die Allgemeinen Geschäftsbedingungen des FED.

Förderung durch Bildungsschecks

Mit dem "Bildungsscheck Nordrhein-Westfalen" fördert die nordrhein-westfälische Landesregierung die Teilnahme an beruflicher Weiterbildung. Nähere Informationen erhalten Sie unter www.bildungsscheck.nrw.de oder auch http://www.bildungspraemie.info.

Ihre Referenten

Arnold Wiemers

arnold wiemers

Arnold Wiemers, LeiterplattenAkademie, ist vom IPC zertifizierter CID, CID+ und Instructor, FED-Designer und FED-Referent. Arnold Wiemers arbeitet am Schulungskonzept des FED mit. Er ist Autor diverser Fachveröffentlichungen, Referent für Seminare, Konferenzvorträge und Workshops zur Leiterplattentechnologie.

Friedbert Hillebrand

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Friedbert Hillebrand verfügt über 25 Jahre Erfahrung in der Elektronik-Entwicklung. Von 1990 bis 2001 war er in der Entwicklung von High-End-Servern verantwortlich für Signal-Integritäts-Analyse und Leiterplatten-Design. Heute arbeitet er u.a. auch als freier Mitarbeiter für den FED.

Gerhard Gröner

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Nach seiner Berufsausbildung in der Elektrotechnik kam Gerhard Gröner zur Leiterplattenentflechtung und war bei der Fa. Grundig über 30 Jahre lang im LP-Designbereich tätig, zuletzt als Leiter einer Zentralabteilung. Seit 1998 ist Herr Gröner als beratender Ingenieur und freier Mitarbeiter im FED tätig. Der Schwerpunkt seiner Arbeit ist hier die Entwicklung eines Schulungskonzeptes für Leiterplatten- und Baugruppendesigner und die Durchführung der hieraus entwickelten Kurse. Seit 2002 ist Herr Gröner Master-Instructor des IPC.

Jennifer Vincenz

Vincenz

Jennifer Vincenz verfügt über weitreichendes und anerkanntes Fachwissen im Bereich CAD-Design. Sie ist vom IPC zertifizierter CID, CID+, Instructor und FED-Designer mit mehr als 20 Jahren Berufserfahrung. Seit April 2010 ist sie bei der tecnotron elektronik GmbH im Bereich Softwarevertrieb tätig. Sie betreut die Kunden sowohl softwarebezogen als auch in technologischen Aspekten und bietet Ihnen fachmännischen Support und Schulungen. Zu ihren Aufgaben gehören zusätzlich die interne Aus- und Weiterbildung und die technische Dokumentation der Pulsonix EDA-Software. Als Referentin arbeitet sie seit 2002 aktiv am Schulungskonzept des FED mit.

Reiner Wieland

Wieland

Nach dem Abschluss seines Ing.-Studiums widmete sich Herr Wieland in verschiedenen Funktionen und Verantwortlichkeiten dem Design von Leiterplatten, der Applikationsunterstützung bei CAD-Systemen und dem Test aufwendiger CAD-Software. Seit 1999 ist Reiner Wieland als selbstständiger Beratungsingenieur für Methoden- und Designberatung im Bereich der Leiterplattenentwicklung tätig. Seit vielen Jahren schenkt er sein Augenmerk auch der Ausbildung und Förderung des Designer-Nachwuchses. So hat Herr Wieland als IPC-Instructor in zahlreichen Kursen des FED viele Techniker und Ingenieure auf die Prüfung zum Certified Interconnect Designer vorbereitet.

Ihre Ansprechpartner

Antje brandt Antje Brandt
Tel. +49 30 834 90 59
E-Mail senden

Sandra Köckeritz Sandra Köckeritz
Tel. +49 30 834 90 59
E-Mail senden
 

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